3.用作缓冲器;
4. 组成计数器:移位寄存器可以组成移位型计数器,如环形或扭环形计数器 。
四、移位寄存器
移位寄存器:具有移位功能的寄存器称为移位寄存器 。
寄存器只有寄存数据或代码的功能 。有时为了处理数据,需要将寄存器中的各位数据在移位控制信号作用下,依次向高位或向低位移动1位 。移位寄存器按数码移动方向分类有左移,右移,可控制双向(可逆)移位寄存器;按数据输入端、输出方式分类有串行和并行之分 。除了D边沿触发器构成移位寄存器外,还可以用诸如JK等触发器构成移位寄存器 。
五、总线收发器/缓冲器
缓冲寄存器:又称缓冲器缓冲器(buffer):多用在总线上,提高驱动能力、隔离前后级,缓冲器多半有三态输出功能 。当负载不具有非选通输出为高阻特性时,将起到隔离作用;当总线的驱动能力不够驱动负载时,将起到驱动作用 。由于缓冲器接在数据总线上,故必须具有三态输出功能 。
它分输入缓冲器和输出缓冲器两种 。前者的作用是将外设送来的数据暂时存放,以便处理器将它取走;后者的作用是用来暂时存放处理器送往外设的数据 。有了数控缓冲器,就可以使高速工作的CPU与慢速工作的外设起协调和缓冲作用,实现数据传送的同步 。
Buffer:缓冲区,一个用于在初速度不同步的设备或者优先级不同的设备之间传输数据的区域 。通过缓冲区,可以使进程之间的相互等待变少,从而使从速度慢的设备读入数据时,速度快的设备的操作进程不发生间断 。
缓冲器主要是计算机领域的称呼 。具体实现上,缓冲器有用锁存器结构的电路来实现,也有用不带锁存结构的电路来实现 。一般来说,当收发数据双方的工作速度匹配时,这里的缓冲器可以用不带锁存结构的电路来实现;而当收发数据双方的工作速度不匹配时,就要用带锁存结构的电路来实现了(否则会出现数据丢失) 。
缓冲器在数字系统中用途很多:
(1)如果器件带负载能力有限,可加一级带驱动器的缓冲器;
(2)前后级间逻辑电平不同,可用电平转换器加以匹配;
(3)逻辑极性不同或需要将单性变量转换为互补变量时,加带反相缓冲器;(4)需要将缓变信号变为边沿陡峭信号时,加带施密特电路的缓冲器
(5)数据传输和处理中不同装置间温度和时间不同时,加一级缓冲器进行弥补等等 。
锁存器与触发器的区别
锁存器和触发器是具有记忆功能的二进制存贮器件,是组成各种时序逻辑电路的基本器件之一 。区别为:latch同其所有的输入信号相关,当输入信号变化时latch就变化,没有时钟端;flip-flop受时钟控制,只有在时钟触发时才采样当前的输入,产生输出 。当然因为latch和flip-flop二者都是时序逻辑,所以输出不但同当前的输入相关还同上一时间的输出相关 。
1、latch由电平触发,非同步控制 。在使能信号有效时latch相当于通路,在使能信号无效时latch保持输出状态 。DFF由时钟沿触发,同步控制 。
2、latch对输入电平敏感,受布线延迟影响较大,很难保证输出没有毛刺产生;DFF则不易产生毛刺 。
3、如果使用门电路来搭建latch和DFF,则latch消耗的门资源比DFF要少,这是latch比DFF优越的地方 。所以,在ASIC中使用 latch的集成度比DFF高,但在FPGA中正好相反,因为FPGA中没有标准的latch单元,但有DFF单元,一个LATCH需要多个LE才能实现 。latch是电平触发,相当于有一个使能端,且在激活之后(在使能电平的时候)相当于导线了,随输出而变化 。在非使能状态下是保持原来的信号,这就可以看出和flip-flop的差别,其实很多时候latch是不能代替ff的 。
4、latch将静态时序分析变得极为复杂 。
5、目前latch只在极高端的电路中使用,如intel 的P4等CPU 。FPGA中有latch单元,寄存器单元就可以配置成latch单元,在xilinx v2p的手册将该单元配置成为register/latch单元,附件是xilinx半个slice的结构图 。其它型号和厂家的FPGA没有去查证 。——个人认为xilinx是能直接配的而altera或许比较麻烦,要几个LE才行,然而也非xilinx的器件每个slice都可以这样配置,altera的只有DDR接口中有专门的latch单元,一般也只有高速电路中会采用latch的设计 。altera的LE是没有latch的结构的,又查了sp3和sp2e,别的不查了,手册上说支持这种配置 。有关altera的表述wangdian说的对,altera的ff不能配置成latch,它使用查找表来实现latch 。
一般的设计规则是:在绝大多数设计中避免产生latch 。它会让您设计的时序完蛋,并且它的隐蔽性很强,非老手不能查出 。latch最大的危害在于不能过滤毛刺 。这对于下一级电路是极其危险的 。所以,只要能用D触发器的地方,就不用latch 。
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