verilog中inoout口的使用问题
【电子科学与技术】 verilog中inoout口的使用问题
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[留学]reg one_wire_buf; // One-Wire总线 缓存寄存器 reg en; assign one_wire = en ? one_wire_buf:16'bZ;想请问一下en赋值为1还是0的时候one_wire输出的是高阻
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